PCB調達ガイド

半導体パッケージングの基礎:
QFP・BGA・CSP・WLP

半導体チップ自体が高性能でも、どうパッケージングするかで最終的な性能と使いやすさは大きく変わります。主要な半導体パッケージの種類と特徴、選定の基準、先端パッケージング技術の動向と調達上の注意点を解説します。

半導体パッケージ 約10分で読めます 9種類+選定基準6項目

この記事では、パッケージングの役割と主要9種類(DIP・SOIC・QFP・QFN・BGA・CSP・WLP・FC-BGA・SiP/PoP)、パッケージ選定の6つの基準(ピン数・サイズ・実装難度・熱設計・電気特性・コスト)、先端パッケージング技術の動向(チップレット・2.5D/3D IC)、そして調達上の注意点(OSAT・EOL・実装要件確認)を体系的に解説します。

POINT 01

パッケージングの役割と主要9種類

半導体パッケージングは、シリコンダイを保護し、外部との電気的・機械的接続を確立し、放熱を確保する役割を担います。パッケージの選択はサイズとピン数、実装しやすさ、熱抵抗と放熱性能、電気的特性(高周波特性・インダクタンス等)、機械的信頼性、コストに影響します。

DIP
Dual In-line Package

スルーホール型。手はんだ可能で教育・試作に今も使われるが量産品では時代遅れ。

SOIC / SOP / TSSOP
小型ガルウィング型

低〜中ピン数で広く使用。サイズやピッチの異なるバリエーションがある表面実装型。

QFP
Quad Flat Package

4辺にリードを持つ。32〜256ピン程度。ファインピッチ(0.4mm以下)は実装難度が上がる。

QFN
Quad Flat No-lead

底面パッドで接続するリードレス型。高周波特性・放熱性に優れる。マイコン・電源IC・RF ICで多用途。

BGA
Ball Grid Array

底面にはんだボールを格子状に配置。100〜1000以上のピン数に対応。CPU・FPGA・高機能ICに使用。

CSP
Chip Scale Package

ダイとほぼ同サイズ。スマートフォン・ウェアラブルに使用。BGA型とリード型がある。

WLP / WLCSP
Wafer Level Package

ウェハー段階で封止する最小サイズ。スマートフォンの電源IC・センサー・RFフロントエンドに広く使用。機械的強度が低くアンダーフィルが必要な場合あり。

FC-BGA
Flip Chip BGA

ダイをフリップして基板と接続。ワイヤーボンディングより電気特性に優れる。高性能CPU・高速通信ICに使用。

SiP / PoP
System in Package / Package on Package

SiP:複数ダイを1パッケージに統合。PoP:パッケージの上にパッケージを積層。スマートフォン・Apple Watchに使用。

X線検査が必要なパッケージ:BGA、QFN、FC-BGA、WLCSPは接合部が外部から目視できないため、実装後に2DまたはCT X線検査が必須です。委託先のEMSがX線設備を保有しているか事前に確認してください。
POINT 02

パッケージ選定の6つの基準

用途に応じた適切なパッケージを選定することで、サイズ・性能・実装容易性・コストのバランスを最適化できます。

選定基準内容と推奨パッケージ
①ピン数 必要な信号線とグラウンドの数から最低限のピン数を見積もる。将来の拡張を見越して余裕を持たせる。多ピン(100以上)にはBGAFC-BGAが対応。
②サイズ 基板上の専有面積と高さから許容パッケージサイズを決める。小型化が必要ならQFNCSPWLPを検討。
③実装難度 ピッチが細かいほどDFM要件が厳しくなる。自社・委託先の実装設備の能力に合ったパッケージを選ぶ。BGAQFNはX線検査設備が必要。
④熱設計 高発熱のICには熱パッド付きQFNやBGAが有利。パッケージの熱抵抗(θJA・θJC)を確認する。
⑤電気特性 高周波・高速信号ではパッケージの寄生インダクタンスと容量が性能に影響する。QFNBGAFC-BGAが有利。
⑥コスト 一般的にサイズが小さく・ピン数が多く・複雑なパッケージほど高価。DIPSOICは安価、FC-BGASiPは高価。

パッケージとX線検査の関係

BGA・QFN・FC-BGAなどリードレスまたは底面接合のパッケージは、実装後の目視検査ができないため、2DまたはCT X線で接合状態を確認します。特にBGAではヘッドインピロー・ボイド・ブリッジなどのBGA特有の不良モードが発生するため、EMSが経験・設備・プロファイラーを保有しているかがEMS選定の重要な基準になります。

POINT 03

先端パッケージング技術の動向

More than Moore — 微細化の壁を超える技術

半導体の微細化が限界に近づく中、「More than Moore(モアザンムーア)」と呼ばれる先端パッケージング技術が注目されています。チップレット・2.5D/3D IC・HBMなど、複数のダイを統合することで性能向上を実現する技術群です。

チップレット:複数の小さなダイを組み合わせて1つのシステムを構成する技術。異なるプロセスノードで製造したダイを統合できるため、コストと性能の最適化が可能。
2.5D IC:インターポーザー(シリコンまたはガラス基板)を介して複数のダイを同一パッケージに搭載する技術。ダイ間の高速・広帯域接続を実現。
3D IC:ダイを縦方向に積層し、TSV(シリコン貫通ビア)で接続する技術。メモリ・ロジック間の帯域幅を飛躍的に向上させる。
HBM(High Bandwidth Memory):3D積層メモリの代表例。AIプロセッサ・GPUに広く採用。
ファンアウトWLP:ダイよりも大きなパッケージをウェハー上で形成する技術。通常のWLCSPより多ピン対応が可能。スマートフォンのアプリケーションプロセッサで採用されている。

主要プレーヤー

先端パッケージングで実績のある企業としては、台湾のTSMC・ASE、韓国のSamsung、日本のKioxia・Socionextなどが挙げられます。受託製造(OSAT:Outsourced Semiconductor Assembly and Test)分野では、ASE・Amkor・JCET(長電科技)などが主要プレーヤーです。

POINT 04

調達上の注意点

パッケージサプライチェーンの理解

半導体チップとパッケージングは、別のサプライチェーンで作られることがあります。ファブ(半導体製造会社)でダイが製造された後、OSAT(外部委託の組み立て・テスト)でパッケージングが行われます。主要なOSATであるASE(台湾)・Amkor(米国)・JCET(中国)は、パッケージングの品質と供給安定性に大きく影響します。先端パッケージング(チップレット・2.5D/3Dなど)は技術的難易度が高く、対応OSATは限られています。

パッケージ変更とEOL対応

メーカーが同じICを異なるパッケージに変更(リパッケージ)するケースがあります。PCN(Product Change Notice)を定期的にモニタリングし、互換性への影響を事前に評価してください。EOL(製造終了)時には互換パッケージの代替品があるか確認し、ラストタイムバイ(最終発注)の数量試算を行います。OSATメーカーが同じダイを異なるパッケージで提供していないかも確認する価値があります。

EMS選定時の実装要件確認

BGAやQFNなど特殊な設備が必要なパッケージを選ぶ場合は、委託先のEMSが対応できるか事前確認が不可欠です。小規模なEMSでは対応できない場合があります。確認すべき能力として、X線検査設備(2D・CT)の有無と解像度、プロファイラーの保有と運用能力、BGA特有の不良モードへの対処経験、真空リフロー対応の可否が挙げられます。

注意:先端パッケージング(SiP・3D IC・FC-BGAなど)を採用する場合、量産フェーズのEMS選定を試作段階から慎重に行ってください。試作と量産でEMSを分けると、実装プロセスの再検証・認定作業に時間とコストがかかり、市場投入を遅らせる原因になります。

まとめ

半導体パッケージングは、チップの性能を最終的に引き出す重要な要素です。用途に応じた適切なパッケージを選定することで、サイズ・性能・実装容易性・コストのバランスを最適化できます。QFNは放熱と高周波特性、BGAは多ピン・高密度、WLP/CSPは超小型という用途の棲み分けを理解し、委託先EMSの実装能力を事前に確認することが、安定した製品品質と調達の基本です。先端パッケージング技術の進化も続いているため、業界動向を把握しながら調達戦略を立てることが中長期的な競争力につながります。

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